LDO也就是線性穩(wěn)壓電路，從應(yīng)用的輸入電壓中減去超額的電壓，產(chǎn)生經(jīng)過調(diào)節(jié)的輸出電壓。LDO（低壓降）穩(wěn)壓器通常使用功率晶體管（也稱為傳遞設(shè)備）作為pNp。本文將淺談一下關(guān)于模擬電路應(yīng)用之LDO的pSRR計算。

講講作者君最近有見過的一個很基本的電路：LDO（Alow-dropoutorLDOregulatorisaDClinearvoltageregulatorthatcanregulatetheoutputvoltageevenwhenthesupplyvoltageisveryclosetotheoutputvoltage.），就是傳說中的無處不在的穩(wěn)壓電路。

作者君搗鼓這個電路的初衷，是看看我調(diào)整了input電壓之后，pSRR有沒有很顯著的惡化。因為之前有個別人做好的LDO，但是input是bandgap的1.2V，作者君把input改成0.8V之后，就稍微改了一些東西：比如把之前OTA的inputpair從pmos變成了nmos。然后，因為這個LDO的pSRR要求比較高，作者君就小小的搗鼓了一下pSRR的計算。

不管怎么說，我們要考慮一個系統(tǒng)的frequencyresponse特性，首先跑不掉的就是loopgain。因此，可以按照下面的公式算出loopgain，其中包括兩個可以預(yù)計到的pole：一個在OTA的output，一個在LDO的output：

可以看出，DC時候的pSRR其實就是整個system的DCgain的一部分。因此，想得到一個大的pSRR，需要有一個比較大的gain的OTA，這個是可以預(yù)料到的。

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